CMOS技術が性能、電力効率、そして価格のバランスを取り続けることを可能にしたのは、プロセスの微細化が継続的に進められてきたことが背景にあるとimecは指摘している。しかし近年、さまざまなアーキテクチャやアプリケーションにおける演算要件が爆発的に増加しており、CMOS技術は前例のないスケーリングとコストの課題に直面するようになってきた。 この課題の解決には、既存のパラダイムを再構築する必要があり、imecでは、ヘテロジニアス・パッケージング(異種チップの2/2.5/3次元実装)の代わりにモノリシック・ヘテロジニアス・オンチップ・インテグレーション(半導体チップの上に別の異種チップを載せることを繰り返してあたかも1つのモノリシックチップのような構成にしたチップ多重積層構造)を次世代技術として実現することを目指しており、このヘテロジニアス・インテグレーションの新たなアプローチを「CMOS 2.