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Chiselで設計したハードウェアをVerilogのRTLに変換する流れのまとめ - ハードウェアの気になるあれこれ
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前回のChiselの記事ではBundleを使ってオプションのIOポートをまとめて制御する方法を紹介した。 www.te... 前回のChiselの記事ではBundleを使ってオプションのIOポートをまとめて制御する方法を紹介した。 www.tech-diningyo.info 最近Chisel周りの調査をいろいろやっているが、ChiselのコードをVerilogのRTLに変換する方法についてを簡単にまとめた日本語の記事が見当たらない気がしたので今更感はあるがまとめておこうと思う。 ChiselのハードウェアデザインからVerilogのRTLを生成する方法 変換するChiselのコードが書かれたファイル build.sbtの準備 ディレクトリ構造 sbtを実行してRTLを生成 まとめ ChiselのハードウェアデザインからVerilogのRTLを生成する方法 stack overflowにまとめてくれているものがあったので、一応こいつも貼っておく。 stackoverflow.com 変換するChiselのコードが