『マイコン・ユーザーのための、 FPGA設計ガイド ～ステップ・バイ・ステップでFPGAにトライ！～』へのコメント

SOPC Builder による高性能 DDR、DDR2、DDR3、 SDRAM の使用

ej_hirao のブックマーク 2009/09/13 16:15

<blockquote class="hatena-bookmark-comment"><a class="comment-info" href="https://b.hatena.ne.jp/entry/15999437/comment/ej_hirao" data-user-id="ej_hirao" data-entry-url="https://b.hatena.ne.jp/entry/s/www.intel.co.jp/content/www/jp/ja/products/programmable.html" data-original-href="https://www.intel.co.jp/content/www/jp/ja/products/programmable.html" data-entry-favicon="https://cdn-ak2.favicon.st-hatena.com/64?url=https%3A%2F%2Fwww.intel.co.jp%2Fcontent%2Fwww%2Fjp%2Fja%2Fproducts%2Fprogrammable.html" data-user-icon="/users/ej_hirao/profile.png">マイコン・ユーザーのための、 FPGA設計ガイド ～ステップ・バイ・ステップでFPGAにトライ！～</a><ul class="comment-tag" style="list-style: none; margin: 0px;"><li style="float: left">[<a href="https://b.hatena.ne.jp/q/FPGA">FPGA</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/Altera">Altera</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/avalon">avalon</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/DDR">DDR</a>]</li></ul><br><p style="clear: left">SOPC Builder による高性能 DDR、DDR2、DDR3、 SDRAM の使用</p><a class="datetime" href="https://b.hatena.ne.jp/ej_hirao/20090913#bookmark-15999437"><span class="datetime-body">2009/09/13 16:15</span></a></blockquote><script src="https://b.st-hatena.com/js/comment-widget.js" charset="utf-8" async></script>

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