バイラテラルフィルタの高速化手法についての発表です.バイラテラルグリッドを改良することで,ウィンドウ半径に応じた演算回数や回路規模の増大を抑え,フルパイプライン化することでその高速なFPGA実装を実際に行いました. 電子情報通信学会研究会のリコンフィギャラブルシステム研究会 (RECONF) での発表資料です (2021/06/09).
バイラテラルフィルタの高速化手法についての発表です.バイラテラルグリッドを改良することで,ウィンドウ半径に応じた演算回数や回路規模の増大を抑え,フルパイプライン化することでその高速なFPGA実装を実際に行いました. 電子情報通信学会研究会のリコンフィギャラブルシステム研究会 (RECONF) での発表資料です (2021/06/09).
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