ZEROからのFPGA : 高位合成ツール「Synthesijer」を使う
【更新履歴】 2019/05/19 githubからインストールする方法に対応 2017/06/04 Synthesijer 20170322版に対応 2016/05/22 Synthesijer 20160511版に対応 2015/11/26 応用例を追加 2015/04/27 公式セットアップスクリプトに準拠する形に修正しました。以前にこのページの方法でセットアップされた方は新しい方法でやり直してください。 2015/03/29 セットアップ用スクリプト「synthesijer-setup.sh」を修正し、方法を少し変えました。以前にこの方法でセットアップされた方は新しいスクリプトに変更して再度スクリプトを実行してください。 Synthesijerは、オープンソースの高位合成ツールです。Javaで書かれたプログラムをHDLにコンバートして論理回路を簡単に設計することができます。 今回は
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Parallellaに日本語環境をセットアップ Parallellaのデスクトップ環境で日本語が使えるように設定します。 2016/12/18 15:30更新（初出2014/05/11 12:20） マンデルブロ集合をFPGAで並列化（固定小数点版） FPGAに実装するマンデルブロ集合のプログラムを固定小数点演算を使って更に高速化します。 2015/04/27 20:50更新（初出2015/04/24 21:40） マンデルブロ集合の浮動小数点演算をFPGAで並列化する Synthesijerを使って、マンデルブロ集合の演算を並列化してFPGAに実装します。 2015/04/27 20:50更新（初出2015/03/11 20:30） SynthesijerでJavaプログラムからHDLコードを自動生成する Synthesijerはオープンソースの高位合成ツールです。通常のJavaプログラ
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