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<電源システムと1つのNAND型フラッシュ・メモリー・チップを組み合わせた場合で比較すると、従来に比べて消費電力を68%低減できる。また、NAND型フラッシュ・メモリーの面積をチップ当たり5~10%削減可能>
fujikumo のブックマーク 2009/02/17 18:56
【ISSCC 2009】東大が3次元SSD向け電源回路を開発、低消費電力と小型化に大きく寄与(1/2) ― EE Times Japan[semiconductor][technology]<電源システムと1つのNAND型フラッシュ・メモリー・チップを組み合わせた場合で比較すると、従来に比べて消費電力を68%低減できる。また、NAND型フラッシュ・メモリーの面積をチップ当たり5~10%削減可能>2009/02/17 18:56
<電源システムと1つのNAND型フラッシュ・メモリー・チップを組み合わせた場合で比較すると、従来に比べて消費電力を68%低減できる。また、NAND型フラッシュ・メモリーの面積をチップ当たり5~10%削減可能>
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eetimes.jp2009/02/17
【ISSCC 2009】東大が3次元SSD向け電源回路を開発、低消費電力と小型化に大きく寄与(2009/02/17) 写真左は試作した電源回路を実装した基板、写真右がNAND型フラッシュ・メモリー・チップである。電源回路は、電...
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【ISSCC 2009】東大が3次元SSD向け電源回路を開発、低消費電力と小型化に大きく寄与(1/2) ― EE Times Japan
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【ISSCC 2009】東大が3次元SSD向け電源回路を開発、低消費電力と小型化に大きく寄与(2009/02/17) 写真左は試作した電源回路を実装した基板、写真右がNAND型フラッシュ・メモリー・チップである。電源回路は、電...
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