既存の設計例を通して、CPUアーキテクチャ、HDLコーディング技法の研究

Wacky のブックマーク 2005/08/21 19:29

<blockquote class="hatena-bookmark-comment"><a class="comment-info" href="https://b.hatena.ne.jp/entry/543887/comment/Wacky" data-user-id="Wacky" data-entry-url="https://b.hatena.ne.jp/entry/japanese.sugawara-systems.com/opencores.htm" data-original-href="http://japanese.sugawara-systems.com/opencores.htm" data-entry-favicon="https://cdn-ak2.favicon.st-hatena.com/64?url=http%3A%2F%2Fjapanese.sugawara-systems.com%2Fopencores.htm" data-user-icon="/users/Wacky/profile.png">Opencores by　Verilog　Source　with VHDL Translation</a><ul class="comment-tag" style="list-style: none; margin: 0px;"><li style="float: left">[<a href="https://b.hatena.ne.jp/q/HDL">HDL</a>]</li></ul><br><p style="clear: left"> 既存の設計例を通して、CPUアーキテクチャ、HDLコーディング技法の研究</p><a class="datetime" href="https://b.hatena.ne.jp/Wacky/20050821#bookmark-543887"><span class="datetime-body">2005/08/21 19:29</span></a></blockquote><script src="https://b.st-hatena.com/js/comment-widget.js" charset="utf-8" async></script>

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