『Excamera』へのコメント

"J1 is a small (200 lines of Verilog) stack-based CPU, intended for FPGAs."

masterq のブックマーク 2016/08/19 12:42

<blockquote class="hatena-bookmark-comment"><a class="comment-info" href="https://b.hatena.ne.jp/entry/97501990/comment/masterq" data-user-id="masterq" data-entry-url="https://b.hatena.ne.jp/entry/s/www.excamera.com/sphinx/index.html" data-original-href="https://www.excamera.com/sphinx/index.html" data-entry-favicon="https://cdn-ak2.favicon.st-hatena.com/64?url=https%3A%2F%2Fwww.excamera.com%2Fsphinx%2Findex.html" data-user-icon="/users/masterq/profile.png">Excamera</a><ul class="comment-tag" style="list-style: none; margin: 0px;"><li style="float: left">[<a href="https://b.hatena.ne.jp/q/forth">forth</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/cpu">cpu</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/fpga">fpga</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/hdl">hdl</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/tcpip">tcpip</a>]</li><li style="float: left">[<a href="https://b.hatena.ne.jp/q/network">network</a>]</li></ul><br><p style="clear: left">&quot;J1 is a small (200 lines of Verilog) stack-based CPU, intended for FPGAs.&quot;</p><a class="datetime" href="https://b.hatena.ne.jp/masterq/20160819#bookmark-97501990"><span class="datetime-body">2016/08/19 12:42</span></a></blockquote><script src="https://b.st-hatena.com/js/comment-widget.js" charset="utf-8" async></script>

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