[B! verilog] zinoueのブックマーク

GTKWave

Welcome to GTKWave GTKWave is a fully featured GTK+ based wave viewer for Unix and Win32 which reads LXT, LXT2, VZT, and GHW files as well as standard Verilog VCD/EVCD files and allows their viewing. You can grab version 3.1.13 here. For cvs access to the experimental, pre-release sourcetree on Sourceforge: cvs -d:pserver:anonymous@gtkwave.cvs.sourceforge.net:/cvsroot/gtkwave login [press enter]

zinoue 2007/10/12

verilog

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Opencores by　Verilog　Source　with VHDL Translation

このページでは、当社で開発したIPやトランスレータを使ってVHDLコアをVerilogに翻訳したもの、OpencoresのVerilog等を紹介していきます。とりあえず、既存の設計例を通して、CPUアーキテクチャ、HDLコーディング技法の研究にお役になれば幸いです。 1.ベンチマークテスト同じCソースプログラムをシミュレータ上で動かして総クロック数を評価してみます。Cソースプログラムは、リードソロモン（５インターリーブ、3重訂正）です。下記オープンソースコアについて行いました。駆動周波数の比較ではなくCPIの比較であることと、オリジナルとの比較ではなく、Opencores上での比較であることに注意してください。 SH2 T80( translated to Verilog by automatically with Veritak Translator) TV80 (T80の下にあり

zinoue 2007/08/30

verilog

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Easics CRC Tool

Polynomial Select a predefined value: Or specify the generator polynomial by clicking on the polynomial terms: x1x2x3x4x5x6x7x8x9x10x11x12x13x14x15x16x17x18x19x20x21x22x23x24x25x26x27x28x29x30x31x32x33x34x35x36x37x38x39x40x41x42x43x44x45x46x47x48x49x50x51x52x53x54x55x56x57x58x59x60x61x62x63x64 1

zinoue 2007/08/30

CRCコードの自動生成

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Kyoshow - PukiWiki

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zinoue 2007/05/30