Veriloggenとcocotbで、PythonのみでVerilogのデザイン・テストを行う。 - Qiitaはじめに Verilog書かずにPythonのみでVerilogのデザイン・テストをやってみました。やってみた系です。 テストは以前書いたcocotb、デザインにはVeriloggenを使用しました。 環境はCentOS6.6になります。 環境構築 Veriloggenを使用するには、作者さんのブログの通り、Pyverilog, Jinja2のインストールが必要になります。 処理系がPython3.3で書かれているため、cocotbとの相性がOS環境も含めて今ひとつよくありません。 よって、ウチの環境ではvirtualenvを使わずに直接インストールしました。 git clone https://github.com/shtaxxx/Pyverilog git clone https://github.com/shtaxxx/veriloggen sudo pip install jinj
