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FPGAのおすすめ教材 - きしだのHatena

ここ最近のエントリを見て、モテたくてFPGAを触りたくなったという人もいるだろうと思います。ただ、FPGAを触るといっても、どこから始めればいいのか、何を買えばいいかわからない人も多いのではないでしょうか。そこで、FPGAを触るために用意するもので、おすすめのものをまとめてみます。下書きでずっと放置していたのですが、ばたばたと公開しておきます。前提としては、今までハードウェアを触ったことのないソフトウェア技術者が、今後FPGAでデータ処理をしてモテるための準備をするということを想定してます。「まず３万円用意します」最初に、FPGAの評価ボードが必要です。いろいろ安い評価ボードもありますが、ある程度最初からデバイスがついていないと楽しくないし、勉強もやりにくいです。また、その評価ボードを使ったテキストも必要になります。そういう点で考えると、いまはDE0一択になると思います。 D

kei_kei 2013/04/07

技術
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ザイリンクス、従来のFPGAとは異なる新ブランド「Zynq」を発表

ザイリンクス、従来のFPGAとは異なる新ブランド「Zynq」を発表：MPUとFPGAの融合で生まれたEPP製品ファミリ「Zynq-7000」ザイリンクスは、ARM Cortex-A9 MPCoreプロセッサをベースとするSoCに、同社28nm 7シリーズFPGAのプログラマブルロジックを統合したEPP（Extensible Processing Platform）製品ファミリ「Zynq-7000」を発表した 2011年3月1日、ザイリンクスは業界初となるエクステンシブルプロセッシングプラットフォーム（Extensible Processing Platform：EPP）の新ブランド「Zynq」および、EPP製品ファミリ「Zynq-7000」を発表した。同製品ファミリは、ARM Cortex-A9 MPCoreプロセッサをベースとするSoCに、同社の次世代FPGA「Artix-7」および

kei_kei 2011/03/02

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FPGAの部屋 UCFの書き方2

kei_kei 2008/07/20

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FPGAの部屋 IOBの入力用FFを活用する

kei_kei 2008/07/20

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FPGAの部屋 UCFの書き方

MIGで使用されている制約 MIGで生成したDDR2 SDRAMコントローラの制約ファイル（UCFファイル）を見ると知らなかった制約を使ったあったので、勉強してみることにする。制約ガイドを参照。（現在、Xilinx社の制約ガイドへのリンクが切れているようです）まずは、RLOCとU_SET。MIGが生成したUCFファイルの一部を引用する。 INST "infrastructure_top0/cal_top0/tap_dly0/l0" RLOC=X0Y6; INST "infrastructure_top0/cal_top0/tap_dly0/l0" U_SET = delay_calibration_chain; RLOC（相対配置制約、原点に対して相対的に位置を指定する。RLOC_ORIGNで原点を指定する）は知っていたのだが、U_SETは知らなかった。U_SETは制約ガイドによると、