Ralf Brown's Interrupt List - HTML Version
Ralf Brown's Interrupt List Indexed HTML Version - Release 61 A Gift to DOS Programmers HTML version of the famous Ralf Brown Interrupt List with over 9000 linked pages and 350 indexes making the process of searching much easier. This list contains every documented and undocumented interrupt call known. Ralf Brown is a Postdoctoral Fellow at Carnegie Mellon University 's Center for Machine Transla
VMware ESX Serverのアーキテクチャ概要 - ＠IT
コンピュータの世界において仮想化とは、資源の物理的特性を抽象化することによって、それを利用するOSやアプリケーション、ユーザーなどから隠ぺいする技法である。それによって、サーバやOS、アプリケーション、ストレージなど1つの物理的な資源（ハードウェア・リソース）を複数の論理的な資源に見せたり、複数のストレージやサーバなどの物理的な資源を1つの論理的なリソースに見せ掛けたりすることが可能になる。現在、一般的に仮想化といった場合は、以下のような種類が挙げられる。 サーバの仮想化 クライアントの仮想化 ストレージの仮想化 アプリケーションの仮想化 ここでは、その中でも特に注目を集めているサーバの仮想化に的を絞って解説していく。サーバの仮想化を使用することによって、1台のサーバ上で複数のOSを同時に稼働させることが可能になる。サーバの仮想化というのは、実はそれほど新しい考え方ではなく、その歴史をたど
後藤弘茂のWeekly海外ニュース
●CPUの中で電力を食う命令デコーダ Nehalemマイクロアーキテクチャには、Intelの今後のCPUの発展の方向性が見て取れる。それは、プログラムの中のホットコード、つまり、頻繁に実行される部分だけを、ボトルネックを避けて、CPUのより深くにキャッシュして、実行を高速化する方向だ。実際、Nehalemマイクロアーキテクチャを見ると、実質的なキャッシュであるループストリームのバッファなどが、CPUの実行エンジンにより近いところに配置され、非常に階層化されたキャッシュ構造になっていることがわかる。そして、これはx86 CPUの場合、自然な進化の流れでもある。 x86 CPUにとって最大の重荷は命令デコーダ(Instruction Decoder)だ。可変長で命令フォーマットが複雑なx86命令のフェッチからデコードにかけては、処理が難しくロジックが複雑になる。そのため、命令デコーダのコスト(
日本IBM、Cellの倍精度浮動小数点演算を5倍に強化した「PowerXCell 8i」
5月14日 発表 日本アイ・ビー・エム株式会社(日本IBM)は14日、「Cell Broadband Engine」(Cell/B.E.)の演算性能を強化した新CPU「PowerXCell 8i」を2基搭載するブレードサーバー「BladeCenter QS22」を発表した。6月6日より出荷を開始する。最小構成価格は138万6,000円。 新たに搭載されたPowerXCell 8iは、エンタープライズ向けHPCに使えるよう、IBMが独自にCell/B.E.の倍精度浮動小数点演算を強化したプロセッサ。Cell/B.E.の浮動小数点演算は、8つのSPEを使って行なわれる。単精度は256GFLOPS(4GHz時)と高速だが、倍精度では約25GFLOPS(同)と約10分の1にまで落ち込む弱点がある。このため、HPC用途の性能には疑問符が付けられることもあった。 PowerXCell 8iはこれを補い
【後藤弘茂のWeekly海外ニュース】なぜIntelはSandy Bridgeに「AVX」を実装するのか
●シングルコア性能を伸ばすための命令セット改革 Intelは、マルチコア性能だけでなく、シングルCPUコアのパフォーマンスを今後も伸ばす。ただし、従来とは違う方法で。CPUの整数演算と浮動小数点演算の性能のバランスを取って、新しく最適化されたソフトウェアだけでなく、既存のソフトウェアの性能を上げるのが、2002年までのアプローチ。それに対して、2010年以降の方向は、SIMD(Single Instruction, Multiple Data)型の浮動小数点演算の性能にフォーカスし、命令セットを大きく拡張する。また、2005年以降から進展してきたマルチコア化も継続する。 そのため、ソフトウェアはマルチスレッド化だけでなく、新命令セットにも積極的に対応して行かないと、CPUのフルパフォーマンスが発揮できなくなる。つまり、よりソフトウェアやコンパイラへとしわ寄せが行くようになる。逆を言えば、I
【後藤弘茂のWeekly海外ニュース】これが超低消費電力「Silverthorne」の正体だ
●64-bitやVTもサポートするSilverthorne Intelの、低消費電力x86 CPU「LPIA(Low Power Intel Architecture)」である「Silverthorne(シルバーソーン)」の正体が見えてきた。現在、米サンフランシスコで開催されている半導体カンファレンス「ISSCC(IEEE International Solid-State Circuits Conference) 2008」では、IntelがSilverthorneの概要について、初めての発表を行なった。 Silverthorneは、TDP(Thermal Design Power:熱設計消費電力)を2W以下に抑えることをターゲットとした、超低消費電力CPUとして設計された。電力は抑えながらも、PC向けCPUと同等の機能(命令)を備えた。Core 2 DuoのSSE3までの命令セットに互
ISSCC 2008レポート - Sunがサーバー向けハイエンドプロセッサ「Rock」の概要を公表
「Rock」(開発コード名)のチップ写真。4億1,000万個のトランジスタを集積した。チップ面積は396平方mm。製造技術は65nmのCMOSプロセス、11層金属配線。チップの中央にクロスバースイッチ(写真での表記はData Switch)、その上下に2次キャッシュ(写真での表記はL2 data)を配置した。なお2次キャッシュの隣にMCUとあるブロックは、メモリコントロールユニット カンファレンス会期：2月4日～6日(現地時間) 会場：米国カリフォルニア州サンフランシスコ市 半導体回路技術に関する世界最大の国際会議「ISSCC 2008」のメインイベントであるカンファレンスが、2月4日(米国時間)午前に始まった。 4日の朝はカンファレンスの開催に先立ち「Formal Opening of the Conference」と題した15分ほどのセッションがあり、ISSCC 2008の概要をISS
【特集】新モバイルプラットフォーム Centrino - パフォーマンス・消費電力・そのすべてに迫る | パソコン | マイコミジャーナル
【特集】 新モバイルプラットフォーム Centrino - パフォーマンス・消費電力・そのすべてに迫る 2003/03/13 大原雄介
【笠原一輝のユビキタス情報局】Intelは、Nehalem世代で5つのCPUコアを投入
Nehalem世代のIntelのCPUコア計画が徐々に判明してきた。 情報筋によれば、IntelはNehalem世代のクライアントPC向けに5つのCPUコアを投入することを計画しているという。すでに判明しているハイエンドPC向けのBloomfieldのほか、デスクトップPC向けにLynnfield(リンフィールド)とHavendale(ヘイブンデール)、ノートPC向けにはClarksfield(クラークスフィールド)とAuburndale(アーバンデール)を2009年に投入する計画であるという。 中でも、メインストリーム向けとなるHavendale、Auburndaleの2製品は、CPUの内部にGPUを内蔵したノースブリッジがMCMの形で実装されており、従来のチップセットで言えばサウスブリッジに相当するPCH(Platform Controller Hub)と呼ばれるIbexpeak(アイ
“ネイティブ”は“ネイティブ？”に勝るか──Phenom出荷直前レビュー
コアを4つ内蔵しているという意味では、インテルのCore 2 Extreme／Quadシリーズと同じだが、その構造は大きく異なっている。Core 2 Extreme／Quadが、「デュアルコアチップ」をCPUの基板上に「2つ搭載」するMCM（Multi Chip Module）と呼ばれる実装方法を採用することでクアッドコアを実現しているのに対して、PhenomではCPUのダイの設計段階から独立した4つのコアを実装している。AMDの言葉を借りるのであればPhenomは“真のクアッドコア”ということになる。 インテルのクアッドコアと比較した“真のクアッドコア”のメリットの例としてキャッシュの同期処理が挙げられる。各コア間でキャッシュの同期（これを“コヒレンシ”と呼ぶ）をとるときに、インテルの場合はCPUの動作クロックより低速なシステムバスを必ず経由する。そのために、システムバスがボトルネックに
NEC、CPU単一コアで100GFLOPS超を実現したベクトルスーパーコンピュータ
日本電気株式会社（以下、NEC）は10月25日、ベクトルスーパーコンピュータの新製品「SXシリーズ モデルSX-9（以下、SX-9）」を発表した。同日から世界同時に販売活動を、2008年3月から出荷を開始する。 SX-9は、ナノテクノロジのシミュレーションのような最先端研究分野、気象・気候解析のような大規模シミュレーション分野などで利用されるスーパーコンピュータ。研究開発のツールとして利用されるのだが、そこでのニーズを、第一コンピュータ事業本部長の西川岳氏は次のように説明する。「研究者の目的は研究成果をいち早く出すこと。生産性を上げるには、プログラミングがしやすく、シミュレーションはとにかく短時間で終わらせなくてはならない」。そこで「使いやすさと高性能の両立をめざした」（同氏）のが、今回のSX-9である。 最大の特徴は、単一コア当たり10億回/秒の浮動小数演算性能に値する102.4GFLO
独自の仕組みでx86アーキテクチャ上に仮想化を実現
VMware ESX Serverは，プロセッサに仮想化支援機能が実装される前から，ソフトウエアによってx86アーキテクチャ上で仮想化を実現してきた。これまでは，VMware ESX Serverのアーキテクチャや仮想マシンの動作原理について，詳細に説明されることはなかった。ここではVMware ESX Serverのアーキテクチャを説明する。最適な設定や，トラブル時のヒントになれば幸いである。 なお，概念的な説明も含まれており，ここで説明することがVMware ESX Serverのすべてではないことをご理解いただきたい。 コアとなる仮想マシンの機能 VMware ESX Server 3.0では，従来のVMware ESX Server 2.xと比べて仮想マシンを構成する各機能に大きな変更はない。だが，実装方式が大きく異なる。ここではまず，VMware ESX Server 2.xのア
後藤弘茂のWeekly海外ニュース
●Nehalemではシステムパーティショニングが変わる Intelは、45nmプロセスのNehalem(ネハーレン)世代から、GPUをCPUへと統合する。CPUとGPUを統合するというビジョン自体は、AMDの次世代CPUと同じだ。しかし、IntelとAMDでは、CPUとGPUの統合の目的と方法が異なる。それは、今後のヘテロジニアス(Heterogeneous:異種混合)型マルチコア時代のCPUをどう創るかという点で、IntelとAMDのビジョンが異なっていることを意味している。 IntelのStephen L. Smith(スティーブ・L・スミス)氏(Vice President, Director, Digital Enterprise Group Operations, Intel)は、NehalemでのGPU統合の理由を次のように説明する。 「今日のシステムパーティショニングでは、F
【後藤弘茂のWeekly海外ニュース】デュアルコアからオクタコアまでスケーラブルなNehalem
●バリエーションの多いNehalem Intelが来年(2008年)後半に投入する次期CPU「Nehalem(ネハーレン)」は、2コアから8コアまでのバリエーションを持つ。最初のNehalemはクアッドコア版だが、Intelは続けて2009年中にデュアルコア、オクタコア、さらにGPU統合版を投入する。これまで、Intelは、ダイ(半導体本体)レベルではCPUのバリエーションを最小に止めてきた。しかし、Nehalemでは、異なるコンフィギュレーションのダイを積極的に展開する。また、投入する市場に合わせて、CPUコア以外の部分の差別化も図る。 IntelのPatrick(Pat) P. Gelsinger(パット・P・ゲルシンガー)氏(Senior Vice President and General Manager, Digital Enterprise Group)は、Nehalemの展開
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