SNES on FPGA ∵スーファミ開発のメモランダム∴
SNES on FPGAスーファミ開発のメモランダム DE2-115 FPGA board (1 chip SNES) スーファミは遊ぶためのもので、開発するためのものではありません。 SFC、つまりスーファミをFPGAで自作した、というお話。 ファミコンの時代、当時としては高い性能だったがそれ以上に実現できなかったクリエイターたちの世界が、 スーファミの時代になり少しずつ実現しつつあった（それはもうICが火を噴かんがごとく）。 デザイナー、バトルプログラマ、ドッター、サウンドプログラマ… 彼らの歴史の中で紡がれてきたものはなんだったのか。 スーファミ互換機の製作。それはスーファミにおいて最後のゲームとなる。 ▼ 開発環境 ハードウェア記述言語 SFL+、VerilogHDL、VHDL 使用FPGAボード Terasic DE1 2005～ Altera CycloneII 約18,000
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A modern, functional, hardware description language Clash is a functional hardware description language that borrows both its syntax and semantics from the functional programming language Haskell. It provides a familiar structural design approach to both combinational and synchronous sequential circuits. The Clash compiler transforms these high-level descriptions to low-level synthesizable VHDL, V
Synthesijer
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LEON - Wikipedia
LEON (from Spanish: león meaning lion) is a radiation-tolerant 32-bit central processing unit (CPU) microprocessor core that implements the SPARC V8 instruction set architecture (ISA) developed by Sun Microsystems. It was originally designed by the European Space Research and Technology Centre (ESTEC), part of the European Space Agency (ESA), without any involvement by Sun. Later versions have bee
JavaRock
Developping JavaRock is over, and the project continues in Synthesijer. Like JavaRock, Synthesijer also aims to develop a compiler from Java to VHDL, which enables hardware design by Java. In addition, Synthesijer generates Verilog HDL and aims to implement advanced features such as optimization, graphical tools, and so on. About JavaRock Download Quick Start Samples License About JavaRock Quick S
Lava
sorter cmp 1 = cmp sorter cmp n = two (sorter cmp (n-1)) >-> sndList reverse >-> bfly cmp n TL;DR: The get a feel for what Lava is and how it is used to design FPGA circuits with layout skim this page and then go straight to A Sorter Example in Lava. A Hardware Description Language in Haskell Netlists in Lava Layout in Lava An Adder Example An Adder Tree in Lava A Sorter Example in Lava A 1D Systo
VHDLによるCPUの設計
シンプルなCPUを作ってみよう （ver. 2 2007.5.9） 信州大学工学部 井澤裕司 このコンテンツでは、ハードウェア記述言語のVHDLを用いて，「 シンプルなCPU 」 を設計する手法 について解説します． 一般に，CPUの設計には、算術演算回路（ALU）等の論理回路から，コンピュータアーキテクチャ の命令セット，アセンブリ言語まで幅広い知識が要求されるため，初心者には「 ハードルの高い 」 ものとなってしまいます． 一方，ソフトウェアの「 C言語 」は，情報系の基礎科目となっており，工学を志すほとんど すべての学生が使いこなすことが可能です． そこで，本コンテンツでは，極めて単純な命令セットをもつCPUの動作を，ソフトウェア上で シミュレーションする「 CPUシミュレータ 」を，C言語を用いて制作します． 次に，この「 CPUシミュレータ 」を，ハード
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GitHub - antonblanchard/microwatt: A tiny Open POWER ISA softcore written in VHDL 2008
Design and Implementation of FPGA based Wi-Fi MAC Transmitter
w11/rtl/sys_gen/w11a/arty/README.md at master · wfjm/w11
GitHub - RobertPeip/FPGBA: GBA on FPGA
GitHub - MiSTer-devel/X68000_MiSTer: Sharp X68000 for MiSTer
GitHub - Domipheus/RPU: Basic RISC-V CPU implementation in VHDL.
2.11BSD
w11: PDP-11/70 CPU and SoC
GitHub - f32c/f32c: A 32-bit MIPS / RISC-V core & SoC, 1.55 DMIPS/MHz, 2.96 CM/Mhz
ultraembedded - Overview
GitHub - maikmerten/riscv-tomthumb: A small RISC-V RV32I core written in VHDL, intended as testbed for my personal VHDL learning
http://papilio.cc/index.php?n=Papilio.PapilioPro