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The reference community for Free and Open Source gateware IP cores Since 1999, OpenCores is the most prominent online community for the development of gateware IP (Intellectual Properties) Cores. It is the place where such cores are shared and promoted in the spirit of Free and Open Source collaboration. The OpenCores portal hosts the source code for different digital gateware projects and support
なつたん
資料はslideshareにあげてます。 高速シリアル通信を支える技術です。 ソフトウェアの人達がおもしろいと思ってくれそうな所を選んで説明したつもりでしたが、あまり手応えは無かったです。もう少しわかりやすくすれば良かったです。今回は今まで以上に質疑応答のレベルが高く、勉強になることが多かったです。全体的にAltera押しの声が多かったですが、高速シリアルとDSPに関してはXilinxの方が先を行っていると言うのを忘れました。 なによりも会場に置いてあった3Dプリンタの性能に驚きました。3Dプリンタって削りだしだと思っていたけど、積層で作っていて後から水で溶ける部材を使うことで、削り出しでは不可能な形も作っていて夢が膨らみました。（そっちかい） スーツで行って来ました！すぐに個人名刺を持ってこなかった事を後悔しました＞＜ オープンソースソフトウェアの翻訳をやらないか GNOME日本語翻訳チ
オプティマイズ（電子工作・ゲームハード解析）
ようこそいらっしゃいました。 オプティマイズは電子工作・ゲームハード解析に興味を持つメンバーの集団です。 ちょっと変わったものを作っていますのでお立ち寄りください。 shop@optimize.ath.cxとsupport@optimize.ath.cxのメールアドレスは使用できません、 をご使用ください。 キャプチャ基板のプロダクトキー確認はこちら パーツショップ このＨＰで取り上げているテーマで必要なパーツ、キット、取り付けサービスを販売しています。 入手しにくいＵＳＢ、ＰＬＤ、マイコンなどのチップも扱っています。 Click here for orders from overseas 電子工作関係 カメレオンＵＳB SPA3NEW! EZ-USB FX2LPとFPGA Spartan3A(XC3S50A)を組み合わせた基板です。FPGAのコンフィグはPC側のアプリケーションからUSB
HuMANDATA LTD. リンクコーナ
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FPGALibre
We don't have an english translation of the whole site. We are looking for volunteers for such a task. Here we will maintain a small list of resources generated by the project. Some resources are just adaptations or enhancements of already existing projects others born from this project. In most cases the resources have its user interface in english. Text editor VHDL Tags Templates Simulator GHDL
Verilog2C++
Introduction Verilog2C++ translates a C++ class of a Verilog design using a cycle-accurate representation of each nets and registers. Verilog2C++ is about 10 times faster than other commercial simulators, but has only simple functions. Verilog2C++ charcteristics Support for IEEE1364-2001 Only two sate simulation Static scheduled and cycle based simulation Not include the simulation kernel Not supp
コンピュータ設計の基礎知識
English here コンピュータをはじめとする論理回路設計に役立つコンテンツを用意しています。 無償ダウンロードとして、ドキュメント・ツール類・開発環境CDROMイメージ・ サンプル回路記述などを置いてあります。ごゆっくりと散策ください。 コンピュータ設計の基礎知識 ?ハードウェア・アーキテクチャ・コンパイラの設計と実装? サポートページ コンピュータ設計の基礎知識?ハードウェア・アーキテクチャ・コンパイラの設計と実装 書店アマゾンへのリンク 「コンピュータ設計の基礎知識」を補完するハードウェア設計の 演習書です。「コンピュータ設計の基礎知識」と併せてご利用ください。 (テキスト第3章)回路設計基礎 演習ノートPDFダウンロード (テキスト第3章)LTspiceによる回路シミュレーション（大槻氏著）PDFダウンロード (テキスト第3章)GNU ElectricによるLSIレイアウト（
PARTHENON HOME PAGE
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FPGAの部屋
My First Nios V for Terasic Atum A3 Nano をやってみよう15（高度なオプションの設定方法） ”My First Nios V for Terasic Atum A3 Nano をやってみよう14（デバッグ）”の続き。 Atum A3 Nano Resources の My First Nios V for Terasic Atum A3 Nano をやってみようということで、前回は、アプリケーションのデバッグを行った。今回は、Ashling RiscFree IDE と Platform Designer の高度なオプションの設定方法を見たが、Ashling RiscFree IDE は System Library Properties が見つからなくてうまく行かなかった。 Quartus Prime Pro 25.1.1 で File メニューか
Lisp CPU
Structures symbol structure: 3 words with type information: value-slot: list of pointers of any type. A new value is prepended on function call and removed on function return. function-slot: pointer of type "primitive" or "list" name-slot: pointer of type "array" list structure: 2 words with type information: car: pointer of any type cdr: pointer of any type array structure: first fixnum specifies
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VerilogでCPU設計入門
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