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TopPage - Verilog HDL & FPGA
FPGAボード（Spartan-3Eスタータキット，またはSpartan-3Aスタータキット）で動作するCPUをVerilog HDLで設計します． さらに，そのCPUをターゲットとするアセンブラとコンパイラも設計します． ソースコードはかなり簡潔に書かれており，コード量がかなり少ない（約250行程度）にもかかわらず，必要最低限の機能をもったＣＰＵがＦＰＧＡボードで正しく動作します． ソースコードの簡潔さに重点をおいているので，回路が使用するリソースや効率化は重視していません． 論理合成ツールの安定性とVerilog HDLの基本構文のみ用いることを考慮し，ソースコードは原則Verilog-95に準拠しています． Verilog 2001などでも論理合成可能です．アセンブラはPerl，コンパイラはflexとbisonで記述されており，きわめて少ないコード量で正しく処理することができます．
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日曜デジタル
先週、何とか時間を工面してESECに行ってきた。 タッチパネルとAndroidが目立ったが、全体としては…どうなんだろ。 まあ、人の集まり具合という意味では、不況の影響はあまりなかったように思う。 そんな中、今年もインテルのブースでノベルティグッズをゲット。 昨年に引き続き、今年もサクマドロップ。 昨年と比べると、大分怖くない缶に仕上がってた。 昨年のは、子供が怖がって手を出さなかったからなあ…。
エックスサーバー サーバー初期ページ
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Opencores by Verilog Source with VHDL Translation
このページでは、当社で開発したIPやトランスレータを使ってVHDLコアをVerilogに翻訳したもの、OpencoresのVerilog等を紹介していきます。 とりあえず、既存の設計例を通して、CPUアーキテクチャ、HDLコーディング技法の研究にお役になれば幸いです。 1.ベンチマークテスト 同じCソースプログラムをシミュレータ上で動かして総クロック数を評価してみます。Cソースプログラムは、リードソロモン（５インターリーブ、3重訂正）です。下記オープンソースコアについて行いました。 駆動周波数の比較ではなくCPIの比較であることと、オリジナルとの比較ではなく、Opencores上での比較であることに注意してください。 SH2 T80( translated to Verilog by automatically with Veritak Translator) TV80 (T80の下にあり
Home :: OpenCores
The reference community for Free and Open Source gateware IP cores Since 1999, OpenCores is the most prominent online community for the development of gateware IP (Intellectual Properties) Cores. It is the place where such cores are shared and promoted in the spirit of Free and Open Source collaboration. The OpenCores portal hosts the source code for different digital gateware projects and support
オプティマイズ（電子工作・ゲームハード解析）
ようこそいらっしゃいました。 オプティマイズは電子工作・ゲームハード解析に興味を持つメンバーの集団です。 ちょっと変わったものを作っていますのでお立ち寄りください。 shop@optimize.ath.cxとsupport@optimize.ath.cxのメールアドレスは使用できません、 をご使用ください。 キャプチャ基板のプロダクトキー確認はこちら パーツショップ このＨＰで取り上げているテーマで必要なパーツ、キット、取り付けサービスを販売しています。 入手しにくいＵＳＢ、ＰＬＤ、マイコンなどのチップも扱っています。 Click here for orders from overseas 電子工作関係 カメレオンＵＳB SPA3NEW! EZ-USB FX2LPとFPGA Spartan3A(XC3S50A)を組み合わせた基板です。FPGAのコンフィグはPC側のアプリケーションからUSB
HuMANDATA LTD. リンクコーナ
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FPGALibre
We don't have an english translation of the whole site. We are looking for volunteers for such a task. Here we will maintain a small list of resources generated by the project. Some resources are just adaptations or enhancements of already existing projects others born from this project. In most cases the resources have its user interface in english. Text editor VHDL Tags Templates Simulator GHDL
Verilog2C++
Introduction Verilog2C++ translates a C++ class of a Verilog design using a cycle-accurate representation of each nets and registers. Verilog2C++ is about 10 times faster than other commercial simulators, but has only simple functions. Verilog2C++ charcteristics Support for IEEE1364-2001 Only two sate simulation Static scheduled and cycle based simulation Not include the simulation kernel Not supp
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ディジタル技術教室（Digital Class）のSyllabus
AO
おいふぉりーのぶろぐ
http://dr.matrix.jp/
サイバーラボ
マイコン・ユーザーのための、 FPGA設計ガイド ～ステップ・バイ・ステップでFPGAにトライ！～
